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Título : Conversor tensão-corrente em tecnologia cmos para um conversor analógico/digital de um sistema em chip
Otros títulos : Voltage to current converter in cmos technology for an analog/digital converter of a system on chip
Autor : Araújo, Genival Mariano de
Orientador(es):: Costa, José Camargo da
Assunto:: Circuitos elétricos
Engenharia elétrica
Circuitos integrados
Fecha de publicación : 24-mar-2010
Citación : ARAUJO, Genival Mariano de. Conversor tensão-corrente em tecnologia cmos para um conversor analógico/digital de um sistema em chip. 2008. 74 f. Dissertação (Mestrado em Engenharia Elétrica)-Universidade de Brasília, Brasília, 2008.
Resumen : Este trabalho apresenta o desenvolvimento do projeto de um conversor tensão-corrente que será agregado a uma interface analógica de um sistema em chip. O conversor VI, como será chamado, é responsável pela conversão dos sinais de tensão, provenientes de um circuito condicionador de sinais, em sinais de corrente antes de Serem entregues um conversor analógico UM-Um conversor (digital / D). Todo desenvolvimento do projeto foi feito na tecnologia CMOS 0,35 μm utilizando programas CAD para captura de esquemático simulação, verificação de regras de projeto, comparação Leiaute esquemático xe Extração de parasitas. A metodologia utilizada foi a de desenvolvimento de projeto analógico, partindo de uma hierarquia de blocos até chegar a um nível de hierarquia mais alto. ______________________________________________________________________________________ ABSTRACT
This work presents the design of a voltage-to-current converter that will be aggregated to an analog interface of a system-on-chip. The V-I converter, as it will be called, is responsible for converting the voltage signals acquired from a signal conditioner circuit into current signals before delivering them to an analog-to-digital converter (A/D converter). The design was developed based on 0.35 μm CMOS process technology using Cadence EDA software for schematic capture, simulation, design rules check, layout versus schematic comparison and parasitic resistence and capacitance extraction. A bottom-up analog design methodology was used, i.e., the blocks were implemented and then integrated in the final system.
metadata.dc.description.unidade: Faculdade de Tecnologia (FT)
Departamento de Engenharia Elétrica (FT ENE)
Descripción : Dissertação (mestrado)—Universidade de Brasília, Faculdade de Tecnologia, Departamento de Engenharia Elétrica, 2008.
metadata.dc.description.ppg: Programa de Pós-Graduação em Engenharia Elétrica
Aparece en las colecciones: Teses, dissertações e produtos pós-doutorado

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